单选题
A数据总线缓冲器
B读/控制逻辑
C控制逻辑
D中断屏蔽寄存器
正确答案
答案解析
略
相似试题
串行优先级判别电路中必要条件是先检测到忙信号输入端处于无效状态，仲裁器接受总线请求输入条件，也是忙线处于无效状态。
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在串联优先级总线判别电路中越靠近总线仲裁器的模块优先级（）。
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串行优先级判别法中，优先级高的模块频繁请求，优先级低的模块可能很长时间都无法获得总线。
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当一个请求被判别为较高优先级时，通过控制逻辑向微处理器发出中断请求信号INT，若微处理器响应中斯并获得响应信号INTA时，使ISR中相应位置作。
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并联优先级判别法中的仲裁机构，当一个模块用总线传输结束以后，总线忙信号被撤销，仲裁器的允许信号置为有效。
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试设计一个采用固定优先级的具有4个输入的集中式独立请求裁决器。
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并联优先级别判别法中有N个模块，都可以作为总线主设备，每个模块都有总线请求线和总线允许线，模块间互相联系，互相制约。
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当有如下中断请求时，微处理器执行完当前指令后，优先响应（）。
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当有如下中断请求时，微处理器执行完当前指令后，优先响应（）。
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