时序逻辑电路与组合逻辑电路最大不同在于前者与电路原来的状态有关。
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时序逻辑电路的技术控制端无效，则电路处于（）状态。
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时序逻辑电路的清零有效，则电路为（）状态。
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时序逻辑电路的计数控制端无效，则电路处于（）状态。
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时序逻辑电路的清零端有效，则电路为（）状态。
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时序逻辑电路的清零端有效，则电路为（）状态。
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时序逻辑电路的置数端有效，则电路为（）状态。
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时序逻辑电路一般是由记忆部分触发器和控制部分组合电路两部分组成的。
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时序逻辑电路的输出不仅与输入有关，还与原来状态有关。
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