CMOS门电路的静态功耗比TTL门电路（）；CMOS门电路的开关速度比TTL门电路（）。
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当外界干扰较小时，TTL与非门闲置的输入端可以悬空处理；TTL或非门不使用的闲置输入端应与地相接；CMOS门输入端口为“与”逻辑关系时，闲置的输入端应接高电平，具有“或”逻辑端口的CMOS门多余的输入端应接低电平；即CMOS门的闲置输入端不允许（）。
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组合逻辑电路主要是由（）、（）和（）三种基本逻辑门电路构成的。
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时序逻辑电路中仅有存储记忆电路而没有逻辑门电路时，构成的电路类型通常称为（）型时序逻辑电路；如果电路中不但除了有存储记忆电路的输入端子，还有逻辑门电路的输入时，构成的电路类型称为（）型时序逻辑电路。
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OC门可以不仅能够实现“总线”结构，还可构成与或非逻辑。
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分析下图所示的组合逻辑电路 1.画出输出F对输入Z的定时关系图（假定输入X和Y都保持高电平，且每个门电路都有一个单位时间的延迟）； 2.判定该电路是否存在有静态冒险问题，如果存在静态冒险，请消除它。
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如何提高CMOS门电路的开关速度？
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CMOS传输门，具有双向传输特性。
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提高CMOS门电路的电源电压可提高电路的抗干扰能力，TTL门电路能否这样做？为什么？
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