组合逻辑电路在任意时刻的输出不仅与该时刻的输入有关，，还与电路原来的状态有关。

在数字电路中，凡是任一时刻的稳定输出不仅决定于该时刻的输入，而且还和电路原来的状态有关者，都叫做时序逻辑电路，简称（）。

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组合逻辑电路的输出状态（）取决于同一时刻输入信号的状态，而与电路原来的状态（）。

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触发器和时序逻辑电路都具有（）功能，在某一时刻的输出不仅取决于此时的（），还与电路（）有关。

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时序逻辑电路的输出和该时刻输入变量的取值有关，且与电路原来的状态无关

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电路的输出态不仅与当前输入信号有关，还与前一时刻的电路状态有关，这种电路为（）。

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译码器的逻辑功能是将某一时刻的（）输入信号译成唯一的输出信号，因此通常称为（）译码器。

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逻辑图和输入A，B的波形如图所示，分析当输出F为“1”的时刻，应是（）

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时序逻辑电路的输出不仅和（）有关，而且和输入状态有关。

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时序逻辑电路的输出不仅取决于（）的状态，还与电路（）的现态有关。

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