如图7-72所示，时钟到来后，JK具有（）功能。

如图7-73所示，时钟到来后，JK具有（）功能。

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已知逻辑电路如图所示，当X=0时，脉冲CP到来后，D触发器（）。

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将JK触发器的J、K端连接起来（如图所示），若脉冲信号、置位端、复位端和数据X端信号如图所示，则输出Q的波形为（）。

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将JK触发器的J、K端连接起来（如图7.5-9所示），若CP脉冲信号、置位端、复位端和数据X端信号如图所示，则输出Q的波形为（）。

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主从JK触发器Q的状态是在时钟脉冲CP（）发生变化。

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如图7-71所示，电路具有（）。

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图a所示电路的滤波特性如图b，由此可知，该电路具有（）。

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如图7-37所示电路，，t=0时闭合开关S后，为下列选项中的（）。

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如图7-70所示电路，Q1、Q2原始状态为11，当输入两个脉冲后的新状态为（）。

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