双稳态触发器是一种具有记忆功能的逻辑部件。

双稳态触发器处于计数状态的逻辑式为Qn+1= n。

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Verilog HDL的register型变量是一种数值容器，不仅可以容纳（），也可以保持（），这一属性与触发器或寄存器的记忆功能有很好的对应关系。

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触发器又称为双稳态电路，因为它具有（）稳定的状态。

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RS触发器具有（）、（）和（）的逻辑功能。

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T’触发器具有（）的逻辑功能。

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（）是一种用来暂时存放一位二进制数码的数字逻辑部件。

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具有记忆和存储功能的电路属于时序逻辑电路，故（）电路是时序逻辑电路。

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触发器和时序逻辑电路都具有（）功能，在某一时刻的输出不仅取决于此时的（），还与电路（）有关。

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简述单稳态触发器与双稳态触发器的特点。

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