CPU访问高速缓存的时间为（）的1/4-1/10.CPU访问的内容在高速缓冲中为命中，否则为不命中或失靶。命中率=（主存读写时间+高速缓存的读写时间-平均读写时间）/主存读写时间。

存储器层次结构是把（）和（）的存储器有机地组织在一起，程序按不同层次存放在各级存储器中，具有较好的速度、容量和价格方面的综合性能指标。形成主存辅存层次和高速缓存主存层次。

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令牌环网络的拓扑结构为环状，采用专用令牌环介质访问控制方式、（）、光纤，传输速率4M-16M.

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考察CPU主要关注（）；（）和每秒中断次数。

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联机测试是（）与CPU的接口部位协调关系，还可进行模拟环路测试。

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数据安全性措施包括（）；（）、文件备份和访问控制。

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访问控制是对（）进行控制，选择性访问控制是进入系统后对文件和程序等资源的访问进行控制。

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令牌总线访问控制方式用于（）和树型网络结构中。

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脱机测试指外设在逻辑上与CPU脱离下对外设运行特定测试程序，进行不含接口部分的（）。

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局域网介质访问控制方式有（）/冲突检测法（CSMA/CD）、令牌环访问控制方式和令牌总线访问控制方式三种。

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