假定主存和磁盘存储器之间连接的同步总线具有以下特性：支持4字块和16字块两种长度（字长32位）的突发传送，总线时钟频率为200MHz，总线宽度为64位，每个64位数据的传送需1个时钟周期，向主存发送一个地址需要1个时钟周期，每个总线事务之间有2个空闲时钟周期。若访问主存时最初四个字的存取时间为200ns，随后每存取一个四字的时间是20ns，磁盘的数据传输率为5MBps，则在4字块和16字块两种传输方式下，该总线上分别最多可有多少个磁盘同时进行传输？

假定某计算机字长16位，没有cache，运算器一次定点加法时间等于100毫微秒，配置的磁盘旋转速度为每分钟3000转，每个磁道上记录两个数据块，每一块有8000个字节，两个数据块之间间隙的越过时间为2毫秒，主存周期为500毫微秒，存储器总线宽度为16位，总线带宽为4MBps。直接寻址的“存储器-存储器”SS型加法指令在无磁盘I/O操作打扰时的执行时间为多少？当磁盘I/O操作与一连串这种SS型加法指令执行同时进行时，则这种SS型加法指令的最快和最慢执行时间各是多少？（假定采用多周期处理器方式，CPU时钟周期等于主存周期）

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假定某计算机字长16位，没有cache，运算器一次定点加法时间等于100毫微秒，配置的磁盘旋转速度为每分钟3000转，每个磁道上记录两个数据块，每一块有8000个字节，两个数据块之间间隙的越过时间为2毫秒，主存周期为500毫微秒，存储器总线宽度为16位，总线带宽为4MBps。

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假定某计算机字长16位，没有cache，运算器一次定点加法时间等于100毫微秒，配置的磁盘旋转速度为每分钟3000转，每个磁道上记录两个数据块，每一块有8000个字节，两个数据块之间间隙的越过时间为2毫秒，主存周期为500毫微秒，存储器总线宽度为16位，总线带宽为4MBps。

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假定某计算机字长16位，没有cache，运算器一次定点加法时间等于100毫微秒，配置的磁盘旋转速度为每分钟3000转，每个磁道上记录两个数据块，每一块有8000个字节，两个数据块之间间隙的越过时间为2毫秒，主存周期为500毫微秒，存储器总线宽度为16位，总线带宽为4MBps。

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假定某计算机字长16位，没有cache，运算器一次定点加法时间等于100毫微秒，配置的磁盘旋转速度为每分钟3000转，每个磁道上记录两个数据块，每一块有8000个字节，两个数据块之间间隙的越过时间为2毫秒，主存周期为500毫微秒，存储器总线宽度为16位，总线带宽为4MBps。

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某计算机的存储系统由Cache、主存和用于虚拟存储的磁盘组成。CPU总是从Cache中获取数据。若所访问的字在Cache中，则存取它只需要20ns，将所访问的字从主存装入Cache需要60ns，而将它从磁盘装入主存则需要1200us。假定Cache的命中率为90%，主存的命中率为60%，计算该系统访问一个字的平均存取时间。

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双总线结构中有两组总线。一组总线是CPU与主存储器之间进行信息交换的公共通路，称为（）

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下图给出了某CPU内部结构的一部分，MAR和MDR直接连到存储器总线（图中省略）。在两个总线之间的所有数据传送都需经过算术逻辑部件ALU。ALU可实现的部分功能及其控制信号如下： MOVa：F=A；MOVb：F=B；a+1：F=A+1；b+1：F=B+1 a-1：F=A-1；b-1：F=B-1其中A和B是ALU的输入，F是ALU的输出。假定JSR（转子指令）指令占两个字，第一个字是操作码，第二个字给出子程序的起始地址，返回地址保存在主存的栈中，用SP（栈指示器）指向栈顶，按字编址，每次从主存读取一个字。请写出读取并执行JSR指令所要求的控制信号序列（提示：当前指令地址在PC中）。

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连接微处理器和内存储器以及I/O接口之间的总线是（）。

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