由或非门构成的基本SR锁存器，当R=S=0时，触发器的状态为不定。

与非门构成的SR锁存器的约束条件是（）

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与非门构成的SR锁存器的输入为当两输入的0状态同时消失时，触发器的输出状态为（）

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用两个或非门构成的基本RS触发器，其R、S须满足的约束条件是（）。

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由两个与非门组成的同步RS触发器，在正常工作时不允许输入S=R=1，即约束条件为SR=（）

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或非门构成的基本RS触发器，输入端SR的约束条件是（）

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若主从结构SR触发器的CLK、S、R、各输入端的电压波形如图所示，试画出Q、Q′对应的电压波形。

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两个与非门构成的基本RS触发器的功能有置0、置1和（）。电路中不允许两个输入端同时为低电平，否则将出现逻辑混乱。

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同步RS触发器中R、S为高电平有效，基本R、S触发器中R、S为（）电平有效。

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在与门电路后面加上非门，就构成了与非门电路。

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