组合逻辑电路的输出状态只与当时的（）有关。

组合逻辑电路在任意时刻的输出不仅与该时刻的输入有关，，还与电路原来的状态有关。

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组合逻辑电路的输出状态（）取决于同一时刻输入信号的状态，而与电路原来的状态（）。

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实现译码功能的组合逻辑电路称为（），每输入一组不同的代码，只有（）个输出呈现有效状态。

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时序逻辑电路的输出不仅和（）有关，而且和输入状态有关。

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时序逻辑电路的输出不仅取决于（）的状态，还与电路（）的现态有关。

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时序逻辑电路的输出和该时刻输入变量的取值有关，且与电路原来的状态无关

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在数字电路中，凡是任一时刻的稳定输出不仅决定于该时刻的输入，而且还和电路原来的状态有关者，都叫做时序逻辑电路，简称（）。

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用8选1数据选择器74HC151（见下图）设计一个组合逻辑电路。该电路有3个输入逻辑变量A、B、C和1个工作状态控制变量M。当M=0时电路实现“意见一致”功能（A、B、C状态一致时输出为1，否则输出为0），而M=1时电路实现“多数表决”功能，即输出与A、B、C中多数的状态一致。

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555电路的输出只能出现两个状态稳定的逻辑电平之一。

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