对JK触发器，在时钟信号CP为高电平期间，当J=K=1时，状态会翻转一次。

对边沿JK触发器，在CP为高电平期间，当J=K=1时，状态会翻转一次。

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对边沿JK触发器，在CP为高电平期间，当J=K=1时，状态会翻转一次。

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当JK触发器在时钟CP作用下，欲使Q*=Q′，则必须使（）

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同步D触发器在CP=1期间，D端输入信号变化时，对输出Q端没有影响。

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已知某（TTL）JK触发器输入端J、K及时钟脉冲CP波形如图所示。请画出输出端Q的相应波形。设触发器初态为0。

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请设计一个序列信号发生器，该电路能在时钟信号CP作用下，周期性输出“110010”的串行序列信号；要求采用最小风险方法设计；采用D触发器和必要门电路实现并画出电路原理图。

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图示是用四个JK触发器组成的四位二进制加法计数器。所有触发器的J=K=1。 （1）试说明其工作原理。  （2）各JK触发器的翻转，是在其各自时钟脉冲的上升沿还是下降沿？  （3）设Q0、Q1、Q2、Q3的初始值均为0。已知CP的波形如图所示，试画出Q0、Q1、Q2、Q3的波形。

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要使JK触发器在时钟作用下的次态与现态相反，JK端取值应为（）。

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主从型JK触发器的从触发器开启时刻在CP下降沿到来时。

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