在VHDL中，语句”FORIIN0TO7LOOP”定义循环次数为（）次。

在VHDL语言中，ARCHITECTURE中的语句都是（）执行的语句。

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在VHDL中，PROCESS本身是（）语句。

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在VHDL中，PROCESS本身是（）语句。

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在VHDL的端口声明语句中，端口方向包括（）、（）、（）和（）。

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在VHDL中，PROCESS结构内部是由（）语句组成的。

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在VHDL中，可以用语句（）表示检测clock下降沿。

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在VHDL的端口声明语句中，用（）声明端口为输入方向。

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在VHDL程序中，以下4个部分，（）可以有顺序执行语句。

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在VHDL语言中，信号赋值语句使用的代入符是（）

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在VHDL语言中，下列对进程（PROCESS）语句的语句结构及语法规则的描述中，不正确的是（）。

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