一个四位二进制的加法计数器，由0000状态开始，经过28个时钟脉冲后，此计数器的状态为（）。

一个初始状态为0000的模值为16的四位二进制递加计数器经过38个CP脉冲后，其状态为0111。

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试用JK触发器设计一个同步五进制加法计数器，要求电路能够自启动。 

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一个四位二进制减法计数器的起始值为1001，经过100个时钟脉冲后的值是（）

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图示是用四个JK触发器组成的四位二进制加法计数器。所有触发器的J=K=1。 （1）试说明其工作原理。  （2）各JK触发器的翻转，是在其各自时钟脉冲的上升沿还是下降沿？  （3）设Q0、Q1、Q2、Q3的初始值均为0。已知CP的波形如图所示，试画出Q0、Q1、Q2、Q3的波形。

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用集成的4位二进制同步加法计数器和与非门可以实现任何计数容量小于16的计数器。

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用二进制异步计数器从0做加法，计到十进制数178，则最少需要（）个触发器。

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对于十进制的减法计数器，原始状态为相当于十进制数9的四位二进制代码，当第十个计数脉冲到来时，计数器的状态为（）。

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设计一个带计数使能、同步复位、带进位输出的增1二十进制计数器，计数结果由共阴极七段数码管显示。

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利用一个74LS90可以构成一个十二进制的计数器。

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