VHDL的实体声明部分指定了设计单元的（）或（），它是设计实体对外的一个通信界面，是外界可以看到的部分。

（）和（）是设计实体的基本组成部分，它们可以构成最基本的VHDL程序。

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VHDL的实体由（）部分和（）组成。

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在VHDL中，一个设计实体可以拥有一个或多个（）。

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在VHDL中（）不能将信息带出对它定义的当前设计单元。

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在VHDL的端口声明语句中，用（）声明端口为输入方向。

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在VHDL的端口声明语句中，用（）声明端口为具有读功能的输出方向

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在VHDL的端口声明语句中，端口方向包括（）、（）、（）和（）。

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下面哪一个可以用作VHDL中的合法的实体名（）。

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在VHDL的FOR_LOOP语句中的循环变量是一个临时变量，属于LOOP语句的局部量，（）事先声明。

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